Current File : //proc/thread-self/root/usr/src/linux-headers-6.8.0-59/include/linux/mfd/rohm-bd71815.h
/* SPDX-License-Identifier: GPL-2.0-or-later */
/*
 * Copyright 2021 ROHM Semiconductors.
 *
 * Author: Matti Vaittinen <matti.vaittinen@fi.rohmeurope.com>
 *
 * Copyright 2014 Embest Technology Co. Ltd. Inc.
 *
 * Author: yanglsh@embest-tech.com
 */

#ifndef _MFD_BD71815_H
#define _MFD_BD71815_H

#include <linux/regmap.h>

enum {
	BD71815_BUCK1	=	0,
	BD71815_BUCK2,
	BD71815_BUCK3,
	BD71815_BUCK4,
	BD71815_BUCK5,
	/* General Purpose */
	BD71815_LDO1,
	BD71815_LDO2,
	BD71815_LDO3,
	/* LDOs for SD Card and SD Card Interface */
	BD71815_LDO4,
	BD71815_LDO5,
	/* LDO for DDR Reference Voltage */
	BD71815_LDODVREF,
	/* LDO for Low-Power State Retention */
	BD71815_LDOLPSR,
	BD71815_WLED,
	BD71815_REGULATOR_CNT,
};

#define BD71815_SUPPLY_STATE_ENABLED    0x1

enum {
	BD71815_REG_DEVICE		= 0,
	BD71815_REG_PWRCTRL,
	BD71815_REG_BUCK1_MODE,
	BD71815_REG_BUCK2_MODE,
	BD71815_REG_BUCK3_MODE,
	BD71815_REG_BUCK4_MODE,
	BD71815_REG_BUCK5_MODE,
	BD71815_REG_BUCK1_VOLT_H,
	BD71815_REG_BUCK1_VOLT_L,
	BD71815_REG_BUCK2_VOLT_H,
	BD71815_REG_BUCK2_VOLT_L,
	BD71815_REG_BUCK3_VOLT,
	BD71815_REG_BUCK4_VOLT,
	BD71815_REG_BUCK5_VOLT,
	BD71815_REG_LED_CTRL,
	BD71815_REG_LED_DIMM,
	BD71815_REG_LDO_MODE1,
	BD71815_REG_LDO_MODE2,
	BD71815_REG_LDO_MODE3,
	BD71815_REG_LDO_MODE4,
	BD71815_REG_LDO1_VOLT,
	BD71815_REG_LDO2_VOLT,
	BD71815_REG_LDO3_VOLT,
	BD71815_REG_LDO4_VOLT,
	BD71815_REG_LDO5_VOLT_H,
	BD71815_REG_LDO5_VOLT_L,
	BD71815_REG_BUCK_PD_DIS,
	BD71815_REG_LDO_PD_DIS,
	BD71815_REG_GPO,
	BD71815_REG_OUT32K,
	BD71815_REG_SEC,
	BD71815_REG_MIN,
	BD71815_REG_HOUR,
	BD71815_REG_WEEK,
	BD71815_REG_DAY,
	BD71815_REG_MONTH,
	BD71815_REG_YEAR,
	BD71815_REG_ALM0_SEC,

	BD71815_REG_ALM1_SEC		= 0x2C,

	BD71815_REG_ALM0_MASK		= 0x33,
	BD71815_REG_ALM1_MASK,
	BD71815_REG_ALM2,
	BD71815_REG_TRIM,
	BD71815_REG_CONF,
	BD71815_REG_SYS_INIT,
	BD71815_REG_CHG_STATE,
	BD71815_REG_CHG_LAST_STATE,
	BD71815_REG_BAT_STAT,
	BD71815_REG_DCIN_STAT,
	BD71815_REG_VSYS_STAT,
	BD71815_REG_CHG_STAT,
	BD71815_REG_CHG_WDT_STAT,
	BD71815_REG_BAT_TEMP,
	BD71815_REG_IGNORE_0,
	BD71815_REG_INHIBIT_0,
	BD71815_REG_DCIN_CLPS,
	BD71815_REG_VSYS_REG,
	BD71815_REG_VSYS_MAX,
	BD71815_REG_VSYS_MIN,
	BD71815_REG_CHG_SET1,
	BD71815_REG_CHG_SET2,
	BD71815_REG_CHG_WDT_PRE,
	BD71815_REG_CHG_WDT_FST,
	BD71815_REG_CHG_IPRE,
	BD71815_REG_CHG_IFST,
	BD71815_REG_CHG_IFST_TERM,
	BD71815_REG_CHG_VPRE,
	BD71815_REG_CHG_VBAT_1,
	BD71815_REG_CHG_VBAT_2,
	BD71815_REG_CHG_VBAT_3,
	BD71815_REG_CHG_LED_1,
	BD71815_REG_VF_TH,
	BD71815_REG_BAT_SET_1,
	BD71815_REG_BAT_SET_2,
	BD71815_REG_BAT_SET_3,
	BD71815_REG_ALM_VBAT_TH_U,
	BD71815_REG_ALM_VBAT_TH_L,
	BD71815_REG_ALM_DCIN_TH,
	BD71815_REG_ALM_VSYS_TH,
	BD71815_REG_VM_IBAT_U,
	BD71815_REG_VM_IBAT_L,
	BD71815_REG_VM_VBAT_U,
	BD71815_REG_VM_VBAT_L,
	BD71815_REG_VM_BTMP,
	BD71815_REG_VM_VTH,
	BD71815_REG_VM_DCIN_U,
	BD71815_REG_VM_DCIN_L,
	BD71815_REG_VM_VSYS,
	BD71815_REG_VM_VF,
	BD71815_REG_VM_OCI_PRE_U,
	BD71815_REG_VM_OCI_PRE_L,
	BD71815_REG_VM_OCV_PRE_U,
	BD71815_REG_VM_OCV_PRE_L,
	BD71815_REG_VM_OCI_PST_U,
	BD71815_REG_VM_OCI_PST_L,
	BD71815_REG_VM_OCV_PST_U,
	BD71815_REG_VM_OCV_PST_L,
	BD71815_REG_VM_SA_VBAT_U,
	BD71815_REG_VM_SA_VBAT_L,
	BD71815_REG_VM_SA_IBAT_U,
	BD71815_REG_VM_SA_IBAT_L,
	BD71815_REG_CC_CTRL,
	BD71815_REG_CC_BATCAP1_TH_U,
	BD71815_REG_CC_BATCAP1_TH_L,
	BD71815_REG_CC_BATCAP2_TH_U,
	BD71815_REG_CC_BATCAP2_TH_L,
	BD71815_REG_CC_BATCAP3_TH_U,
	BD71815_REG_CC_BATCAP3_TH_L,
	BD71815_REG_CC_STAT,
	BD71815_REG_CC_CCNTD_3,
	BD71815_REG_CC_CCNTD_2,
	BD71815_REG_CC_CCNTD_1,
	BD71815_REG_CC_CCNTD_0,
	BD71815_REG_CC_CURCD_U,
	BD71815_REG_CC_CURCD_L,
	BD71815_REG_VM_OCUR_THR_1,
	BD71815_REG_VM_OCUR_DUR_1,
	BD71815_REG_VM_OCUR_THR_2,
	BD71815_REG_VM_OCUR_DUR_2,
	BD71815_REG_VM_OCUR_THR_3,
	BD71815_REG_VM_OCUR_DUR_3,
	BD71815_REG_VM_OCUR_MON,
	BD71815_REG_VM_BTMP_OV_THR,
	BD71815_REG_VM_BTMP_OV_DUR,
	BD71815_REG_VM_BTMP_LO_THR,
	BD71815_REG_VM_BTMP_LO_DUR,
	BD71815_REG_VM_BTMP_MON,
	BD71815_REG_INT_EN_01,

	BD71815_REG_INT_EN_11		= 0x95,
	BD71815_REG_INT_EN_12,
	BD71815_REG_INT_STAT,
	BD71815_REG_INT_STAT_01,
	BD71815_REG_INT_STAT_02,
	BD71815_REG_INT_STAT_03,
	BD71815_REG_INT_STAT_04,
	BD71815_REG_INT_STAT_05,
	BD71815_REG_INT_STAT_06,
	BD71815_REG_INT_STAT_07,
	BD71815_REG_INT_STAT_08,
	BD71815_REG_INT_STAT_09,
	BD71815_REG_INT_STAT_10,
	BD71815_REG_INT_STAT_11,
	BD71815_REG_INT_STAT_12,
	BD71815_REG_INT_UPDATE,

	BD71815_REG_VM_VSYS_U		= 0xC0,
	BD71815_REG_VM_VSYS_L,
	BD71815_REG_VM_SA_VSYS_U,
	BD71815_REG_VM_SA_VSYS_L,

	BD71815_REG_VM_SA_IBAT_MIN_U	= 0xD0,
	BD71815_REG_VM_SA_IBAT_MIN_L,
	BD71815_REG_VM_SA_IBAT_MAX_U,
	BD71815_REG_VM_SA_IBAT_MAX_L,
	BD71815_REG_VM_SA_VBAT_MIN_U,
	BD71815_REG_VM_SA_VBAT_MIN_L,
	BD71815_REG_VM_SA_VBAT_MAX_U,
	BD71815_REG_VM_SA_VBAT_MAX_L,
	BD71815_REG_VM_SA_VSYS_MIN_U,
	BD71815_REG_VM_SA_VSYS_MIN_L,
	BD71815_REG_VM_SA_VSYS_MAX_U,
	BD71815_REG_VM_SA_VSYS_MAX_L,
	BD71815_REG_VM_SA_MINMAX_CLR,

	BD71815_REG_REX_CCNTD_3		= 0xE0,
	BD71815_REG_REX_CCNTD_2,
	BD71815_REG_REX_CCNTD_1,
	BD71815_REG_REX_CCNTD_0,
	BD71815_REG_REX_SA_VBAT_U,
	BD71815_REG_REX_SA_VBAT_L,
	BD71815_REG_REX_CTRL_1,
	BD71815_REG_REX_CTRL_2,
	BD71815_REG_FULL_CCNTD_3,
	BD71815_REG_FULL_CCNTD_2,
	BD71815_REG_FULL_CCNTD_1,
	BD71815_REG_FULL_CCNTD_0,
	BD71815_REG_FULL_CTRL,

	BD71815_REG_CCNTD_CHG_3		= 0xF0,
	BD71815_REG_CCNTD_CHG_2,

	BD71815_REG_TEST_MODE		= 0xFE,
	BD71815_MAX_REGISTER,
};

/* BD71815_REG_BUCK1_MODE bits */
#define BD71815_BUCK_RAMPRATE_MASK		0xC0
#define BD71815_BUCK_RAMPRATE_10P00MV		0x0
#define BD71815_BUCK_RAMPRATE_5P00MV		0x01
#define BD71815_BUCK_RAMPRATE_2P50MV		0x02
#define BD71815_BUCK_RAMPRATE_1P25MV		0x03

#define BD71815_BUCK_PWM_FIXED			BIT(4)
#define BD71815_BUCK_SNVS_ON			BIT(3)
#define BD71815_BUCK_RUN_ON			BIT(2)
#define BD71815_BUCK_LPSR_ON			BIT(1)
#define BD71815_BUCK_SUSP_ON			BIT(0)

/* BD71815_REG_BUCK1_VOLT_H bits */
#define BD71815_BUCK_DVSSEL			BIT(7)
#define BD71815_BUCK_STBY_DVS			BIT(6)
#define BD71815_VOLT_MASK			0x3F
#define BD71815_BUCK1_H_DEFAULT			0x14
#define BD71815_BUCK1_L_DEFAULT			0x14

/* BD71815_REG_BUCK2_VOLT_H bits */
#define BD71815_BUCK2_H_DEFAULT			0x14
#define BD71815_BUCK2_L_DEFAULT			0x14

/* WLED output */
/* current register mask */
#define LED_DIMM_MASK				0x3f
/* LED enable bits at LED_CTRL reg */
#define LED_CHGDONE_EN				BIT(4)
#define LED_RUN_ON				BIT(2)
#define LED_LPSR_ON				BIT(1)
#define LED_SUSP_ON				BIT(0)

/* BD71815_REG_LDO1_CTRL bits */
#define LDO1_EN					BIT(0)
#define LDO2_EN					BIT(1)
#define LDO3_EN					BIT(2)
#define DVREF_EN				BIT(3)
#define VOSNVS_SW_EN				BIT(4)

/* LDO_MODE1_register */
#define LDO1_SNVS_ON				BIT(7)
#define LDO1_RUN_ON				BIT(6)
#define LDO1_LPSR_ON				BIT(5)
#define LDO1_SUSP_ON				BIT(4)
/* set => register control, unset => GPIO control */
#define LDO4_MODE_MASK				BIT(3)
#define LDO4_MODE_I2C				BIT(3)
#define LDO4_MODE_GPIO				0
/* set => register control, unset => start when DCIN connected */
#define LDO3_MODE_MASK				BIT(2)
#define LDO3_MODE_I2C				BIT(2)
#define LDO3_MODE_DCIN				0

/* LDO_MODE2 register */
#define LDO3_SNVS_ON				BIT(7)
#define LDO3_RUN_ON				BIT(6)
#define LDO3_LPSR_ON				BIT(5)
#define LDO3_SUSP_ON				BIT(4)
#define LDO2_SNVS_ON				BIT(3)
#define LDO2_RUN_ON				BIT(2)
#define LDO2_LPSR_ON				BIT(1)
#define LDO2_SUSP_ON				BIT(0)


/* LDO_MODE3 register */
#define LDO5_SNVS_ON				BIT(7)
#define LDO5_RUN_ON				BIT(6)
#define LDO5_LPSR_ON				BIT(5)
#define LDO5_SUSP_ON				BIT(4)
#define LDO4_SNVS_ON				BIT(3)
#define LDO4_RUN_ON				BIT(2)
#define LDO4_LPSR_ON				BIT(1)
#define LDO4_SUSP_ON				BIT(0)

/* LDO_MODE4 register */
#define DVREF_SNVS_ON				BIT(7)
#define DVREF_RUN_ON				BIT(6)
#define DVREF_LPSR_ON				BIT(5)
#define DVREF_SUSP_ON				BIT(4)
#define LDO_LPSR_SNVS_ON			BIT(3)
#define LDO_LPSR_RUN_ON				BIT(2)
#define LDO_LPSR_LPSR_ON			BIT(1)
#define LDO_LPSR_SUSP_ON			BIT(0)

/* BD71815_REG_OUT32K bits */
#define OUT32K_EN				BIT(0)
#define OUT32K_MODE				BIT(1)
#define OUT32K_MODE_CMOS			BIT(1)
#define OUT32K_MODE_OPEN_DRAIN			0

/* BD71815_REG_BAT_STAT bits */
#define BAT_DET					BIT(5)
#define BAT_DET_OFFSET				5
#define BAT_DET_DONE				BIT(4)
#define VBAT_OV					BIT(3)
#define DBAT_DET				BIT(0)

/* BD71815_REG_VBUS_STAT bits */
#define VBUS_DET				BIT(0)

#define BD71815_REG_RTC_START			BD71815_REG_SEC
#define BD71815_REG_RTC_ALM_START		BD71815_REG_ALM0_SEC

/* BD71815_REG_ALM0_MASK bits */
#define A0_ONESEC				BIT(7)

/* BD71815_REG_INT_EN_00 bits */
#define ALMALE					BIT(0)

/* BD71815_REG_INT_STAT_03 bits */
#define DCIN_MON_DET				BIT(1)
#define DCIN_MON_RES				BIT(0)
#define POWERON_LONG				BIT(2)
#define POWERON_MID				BIT(3)
#define POWERON_SHORT				BIT(4)
#define POWERON_PRESS				BIT(5)

/* BD71805_REG_INT_STAT_08 bits */
#define VBAT_MON_DET				BIT(1)
#define VBAT_MON_RES				BIT(0)

/* BD71805_REG_INT_STAT_11 bits */
#define	INT_STAT_11_VF_DET			BIT(7)
#define	INT_STAT_11_VF_RES			BIT(6)
#define	INT_STAT_11_VF125_DET			BIT(5)
#define	INT_STAT_11_VF125_RES			BIT(4)
#define	INT_STAT_11_OVTMP_DET			BIT(3)
#define	INT_STAT_11_OVTMP_RES			BIT(2)
#define	INT_STAT_11_LOTMP_DET			BIT(1)
#define	INT_STAT_11_LOTMP_RES			BIT(0)

#define VBAT_MON_DET				BIT(1)
#define VBAT_MON_RES				BIT(0)

/* BD71815_REG_PWRCTRL bits */
#define RESTARTEN				BIT(0)

/* BD71815_REG_GPO bits */
#define READY_FORCE_LOW				BIT(2)
#define BD71815_GPIO_DRIVE_MASK			BIT(4)
#define BD71815_GPIO_OPEN_DRAIN			0
#define BD71815_GPIO_CMOS			BIT(4)

/* BD71815 interrupt masks */
enum {
	BD71815_INT_EN_01_BUCKAST_MASK	=	0x0F,
	BD71815_INT_EN_02_DCINAST_MASK	=	0x3E,
	BD71815_INT_EN_03_DCINAST_MASK	=	0x3F,
	BD71815_INT_EN_04_VSYSAST_MASK	=	0xCF,
	BD71815_INT_EN_05_CHGAST_MASK	=	0xFC,
	BD71815_INT_EN_06_BATAST_MASK	=	0xF3,
	BD71815_INT_EN_07_BMONAST_MASK	=	0xFE,
	BD71815_INT_EN_08_BMONAST_MASK	=	0x03,
	BD71815_INT_EN_09_BMONAST_MASK	=	0x07,
	BD71815_INT_EN_10_BMONAST_MASK	=	0x3F,
	BD71815_INT_EN_11_TMPAST_MASK	=	0xFF,
	BD71815_INT_EN_12_ALMAST_MASK	=	0x07,
};
/* BD71815 interrupt irqs */
enum {
	/* BUCK reg interrupts */
	BD71815_INT_BUCK1_OCP,
	BD71815_INT_BUCK2_OCP,
	BD71815_INT_BUCK3_OCP,
	BD71815_INT_BUCK4_OCP,
	BD71815_INT_BUCK5_OCP,
	BD71815_INT_LED_OVP,
	BD71815_INT_LED_OCP,
	BD71815_INT_LED_SCP,
	/* DCIN1 interrupts */
	BD71815_INT_DCIN_RMV,
	BD71815_INT_CLPS_OUT,
	BD71815_INT_CLPS_IN,
	BD71815_INT_DCIN_OVP_RES,
	BD71815_INT_DCIN_OVP_DET,
	/* DCIN2 interrupts */
	BD71815_INT_DCIN_MON_RES,
	BD71815_INT_DCIN_MON_DET,
	BD71815_INT_WDOG,
	/* Vsys INT_STAT_04 */
	BD71815_INT_VSYS_UV_RES,
	BD71815_INT_VSYS_UV_DET,
	BD71815_INT_VSYS_LOW_RES,
	BD71815_INT_VSYS_LOW_DET,
	BD71815_INT_VSYS_MON_RES,
	BD71815_INT_VSYS_MON_DET,
	/* Charger INT_STAT_05 */
	BD71815_INT_CHG_WDG_TEMP,
	BD71815_INT_CHG_WDG_TIME,
	BD71815_INT_CHG_RECHARGE_RES,
	BD71815_INT_CHG_RECHARGE_DET,
	BD71815_INT_CHG_RANGED_TEMP_TRANSITION,
	BD71815_INT_CHG_STATE_TRANSITION,
	/* Battery  INT_STAT_06 */
	BD71815_INT_BAT_TEMP_NORMAL,
	BD71815_INT_BAT_TEMP_ERANGE,
	BD71815_INT_BAT_REMOVED,
	BD71815_INT_BAT_DETECTED,
	BD71815_INT_THERM_REMOVED,
	BD71815_INT_THERM_DETECTED,
	/* Battery Mon 1 INT_STAT_07 */
	BD71815_INT_BAT_DEAD,
	BD71815_INT_BAT_SHORTC_RES,
	BD71815_INT_BAT_SHORTC_DET,
	BD71815_INT_BAT_LOW_VOLT_RES,
	BD71815_INT_BAT_LOW_VOLT_DET,
	BD71815_INT_BAT_OVER_VOLT_RES,
	BD71815_INT_BAT_OVER_VOLT_DET,
	/* Battery Mon 2 INT_STAT_08 */
	BD71815_INT_BAT_MON_RES,
	BD71815_INT_BAT_MON_DET,
	/* Battery Mon 3 (Coulomb counter) INT_STAT_09 */
	BD71815_INT_BAT_CC_MON1,
	BD71815_INT_BAT_CC_MON2,
	BD71815_INT_BAT_CC_MON3,
	/* Battery Mon 4 INT_STAT_10 */
	BD71815_INT_BAT_OVER_CURR_1_RES,
	BD71815_INT_BAT_OVER_CURR_1_DET,
	BD71815_INT_BAT_OVER_CURR_2_RES,
	BD71815_INT_BAT_OVER_CURR_2_DET,
	BD71815_INT_BAT_OVER_CURR_3_RES,
	BD71815_INT_BAT_OVER_CURR_3_DET,
	/* Temperature INT_STAT_11 */
	BD71815_INT_TEMP_BAT_LOW_RES,
	BD71815_INT_TEMP_BAT_LOW_DET,
	BD71815_INT_TEMP_BAT_HI_RES,
	BD71815_INT_TEMP_BAT_HI_DET,
	BD71815_INT_TEMP_CHIP_OVER_125_RES,
	BD71815_INT_TEMP_CHIP_OVER_125_DET,
	BD71815_INT_TEMP_CHIP_OVER_VF_RES,
	BD71815_INT_TEMP_CHIP_OVER_VF_DET,
	/* RTC Alarm INT_STAT_12 */
	BD71815_INT_RTC0,
	BD71815_INT_RTC1,
	BD71815_INT_RTC2,
};

#define BD71815_INT_BUCK1_OCP_MASK			BIT(0)
#define BD71815_INT_BUCK2_OCP_MASK			BIT(1)
#define BD71815_INT_BUCK3_OCP_MASK			BIT(2)
#define BD71815_INT_BUCK4_OCP_MASK			BIT(3)
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¿Qué es la limpieza dental de perros? - Clínica veterinaria


Es la eliminación del sarro y la placa adherida a la superficie de los dientes mediante un equipo de ultrasonidos que garantiza la integridad de las piezas dentales a la vez que elimina en profundidad cualquier resto de suciedad.

A continuación se procede al pulido de los dientes mediante una fresa especial que elimina la placa bacteriana y devuelve a los dientes el aspecto sano que deben tener.

Una vez terminado todo el proceso, se mantiene al perro en observación hasta que se despierta de la anestesia, bajo la atenta supervisión de un veterinario.

¿Cada cuánto tiempo tengo que hacerle una limpieza dental a mi perro?

A partir de cierta edad, los perros pueden necesitar una limpieza dental anual o bianual. Depende de cada caso. En líneas generales, puede decirse que los perros de razas pequeñas suelen acumular más sarro y suelen necesitar una atención mayor en cuanto a higiene dental.


Riesgos de una mala higiene


Los riesgos más evidentes de una mala higiene dental en los perros son los siguientes:

  • Cuando la acumulación de sarro no se trata, se puede producir una inflamación y retracción de las encías que puede descalzar el diente y provocar caídas.
  • Mal aliento (halitosis).
  • Sarro perros
  • Puede ir a más
  • Las bacterias de la placa pueden trasladarse a través del torrente circulatorio a órganos vitales como el corazón ocasionando problemas de endocarditis en las válvulas. Las bacterias pueden incluso acantonarse en huesos (La osteomielitis es la infección ósea, tanto cortical como medular) provocando mucho dolor y una artritis séptica).

¿Cómo se forma el sarro?

El sarro es la calcificación de la placa dental. Los restos de alimentos, junto con las bacterias presentes en la boca, van a formar la placa bacteriana o placa dental. Si la placa no se retira, al mezclarse con la saliva y los minerales presentes en ella, reaccionará formando una costra. La placa se calcifica y se forma el sarro.

El sarro, cuando se forma, es de color blanquecino pero a medida que pasa el tiempo se va poniendo amarillo y luego marrón.

Síntomas de una pobre higiene dental
La señal más obvia de una mala salud dental canina es el mal aliento.

Sin embargo, a veces no es tan fácil de detectar
Y hay perros que no se dejan abrir la boca por su dueño. Por ejemplo…

Recientemente nos trajeron a la clínica a un perro que parpadeaba de un ojo y decía su dueño que le picaba un lado de la cara. Tenía molestias y dificultad para comer, lo que había llevado a sus dueños a comprarle comida blanda (que suele ser un poco más cara y llevar más contenido en grasa) durante medio año. Después de una exploración oftalmológica, nos dimos cuenta de que el ojo tenía una úlcera en la córnea probablemente de rascarse . Además, el canto lateral del ojo estaba inflamado. Tenía lo que en humanos llamamos flemón pero como era un perro de pelo largo, no se le notaba a simple vista. Al abrirle la boca nos llamó la atención el ver una muela llena de sarro. Le realizamos una radiografía y encontramos una fístula que llegaba hasta la parte inferior del ojo.

Le tuvimos que extraer la muela. Tras esto, el ojo se curó completamente con unos colirios y una lentilla protectora de úlcera. Afortunadamente, la úlcera no profundizó y no perforó el ojo. Ahora el perro come perfectamente a pesar de haber perdido una muela.

¿Cómo mantener la higiene dental de tu perro?
Hay varias maneras de prevenir problemas derivados de la salud dental de tu perro.

Limpiezas de dientes en casa
Es recomendable limpiar los dientes de tu perro semanal o diariamente si se puede. Existe una gran variedad de productos que se pueden utilizar:

Pastas de dientes.
Cepillos de dientes o dedales para el dedo índice, que hacen más fácil la limpieza.
Colutorios para echar en agua de bebida o directamente sobre el diente en líquido o en spray.

En la Clínica Tus Veterinarios enseñamos a nuestros clientes a tomar el hábito de limpiar los dientes de sus perros desde que son cachorros. Esto responde a nuestro compromiso con la prevención de enfermedades caninas.

Hoy en día tenemos muchos clientes que limpian los dientes todos los días a su mascota, y como resultado, se ahorran el dinero de hacer limpiezas dentales profesionales y consiguen una mejor salud de su perro.


Limpiezas dentales profesionales de perros y gatos

Recomendamos hacer una limpieza dental especializada anualmente. La realizamos con un aparato de ultrasonidos que utiliza agua para quitar el sarro. Después, procedemos a pulir los dientes con un cepillo de alta velocidad y una pasta especial. Hacemos esto para proteger el esmalte.

La frecuencia de limpiezas dentales necesaria varía mucho entre razas. En general, las razas grandes tienen buena calidad de esmalte, por lo que no necesitan hacerlo tan a menudo e incluso pueden pasarse la vida sin requerir una limpieza. Sin embargo, razas pequeñas como el Yorkshire o el Maltés, deben hacérselas todos los años desde cachorros si se quiere conservar sus piezas dentales.

Otro factor fundamental es la calidad del pienso. Algunas marcas han diseñado croquetas que limpian la superficie del diente y de la muela al masticarse.

Ultrasonido para perros

¿Se necesita anestesia para las limpiezas dentales de perros y gatos?

La limpieza dental en perros no es una técnica que pueda practicarse sin anestesia general , aunque hay veces que los propietarios no quieren anestesiar y si tiene poco sarro y el perro es muy bueno se puede intentar…… , pero no se va a poder pulir ni acceder a todas la zona de la boca …. Además los limpiadores dentales van a irrigar agua y hay riesgo de aspiración a vías respiratorias si no se realiza una anestesia correcta con intubación traqueal . En resumen , sin anestesia no se va hacer una correcta limpieza dental.

Tampoco sirve la sedación ya que necesitamos que el animal esté totalmente quieto, y el veterinario tenga un acceso completo a todas sus piezas dentales y encías.

Alimentos para la limpieza dental

Hay que tener cierto cuidado a la hora de comprar determinados alimentos porque no todos son saludables. Algunos tienen demasiado contenido graso, que en exceso puede causar problemas cardiovasculares y obesidad.

Los mejores alimentos para los dientes son aquellos que están elaborados por empresas farmacéuticas y llevan componentes químicos con tratamientos específicos para el diente del perro. Esto implica no solo limpieza a través de la acción mecánica de morder sino también un tratamiento antibacteriano para prevenir el sarro.

Conclusión

Si eres como la mayoría de dueños, por falta de tiempo , es probable que no estés prestando la suficiente atención a la limpieza dental de tu perro. Por eso te animamos a que comiences a limpiar los dientes de tu perro y consideres atender a su higiene bucal con frecuencia.

Estas simples medidas pueden conllevar a que tu perro tenga una vida más larga y mucho más saludable.

Si te resulta imposible introducir un cepillo de dientes a tu perro en la boca, pásate con él por clínica Tus Veterinarios y te explicamos cómo hacerlo.

Necesitas hacer una limpieza dental profesional a tu mascota?
Llámanos al 622575274 o contacta con nosotros

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