/* SPDX-License-Identifier: GPL-2.0-only */ /* * Copyright (C) 2006-2008 PA Semi, Inc * * Hardware register layout and descriptor formats for the on-board * DMA engine on PA Semi PWRficient. Used by ethernet, function and security * drivers. */ #ifndef ASM_PASEMI_DMA_H #define ASM_PASEMI_DMA_H /* status register layout in IOB region, at 0xfb800000 */ struct pasdma_status { u64 rx_sta[64]; /* RX channel status */ u64 tx_sta[20]; /* TX channel status */ }; /* All these registers live in the PCI configuration space for the DMA PCI * device. Use the normal PCI config access functions for them. */ enum { PAS_DMA_CAP_TXCH = 0x44, /* Transmit Channel Info */ PAS_DMA_CAP_RXCH = 0x48, /* Transmit Channel Info */ PAS_DMA_CAP_IFI = 0x4c, /* Interface Info */ PAS_DMA_COM_TXCMD = 0x100, /* Transmit Command Register */ PAS_DMA_COM_TXSTA = 0x104, /* Transmit Status Register */ PAS_DMA_COM_RXCMD = 0x108, /* Receive Command Register */ PAS_DMA_COM_RXSTA = 0x10c, /* Receive Status Register */ PAS_DMA_COM_CFG = 0x114, /* Common config reg */ PAS_DMA_TXF_SFLG0 = 0x140, /* Set flags */ PAS_DMA_TXF_SFLG1 = 0x144, /* Set flags */ PAS_DMA_TXF_CFLG0 = 0x148, /* Set flags */ PAS_DMA_TXF_CFLG1 = 0x14c, /* Set flags */ }; #define PAS_DMA_CAP_TXCH_TCHN_M 0x00ff0000 /* # of TX channels */ #define PAS_DMA_CAP_TXCH_TCHN_S 16 #define PAS_DMA_CAP_RXCH_RCHN_M 0x00ff0000 /* # of RX channels */ #define PAS_DMA_CAP_RXCH_RCHN_S 16 #define PAS_DMA_CAP_IFI_IOFF_M 0xff000000 /* Cfg reg for intf pointers */ #define PAS_DMA_CAP_IFI_IOFF_S 24 #define PAS_DMA_CAP_IFI_NIN_M 0x00ff0000 /* # of interfaces */ #define PAS_DMA_CAP_IFI_NIN_S 16 #define PAS_DMA_COM_TXCMD_EN 0x00000001 /* enable */ #define PAS_DMA_COM_TXSTA_ACT 0x00000001 /* active */ #define PAS_DMA_COM_RXCMD_EN 0x00000001 /* enable */ #define PAS_DMA_COM_RXSTA_ACT 0x00000001 /* active */ /* Per-interface and per-channel registers */ #define _PAS_DMA_RXINT_STRIDE 0x20 #define PAS_DMA_RXINT_RCMDSTA(i) (0x200+(i)*_PAS_DMA_RXINT_STRIDE) #define PAS_DMA_RXINT_RCMDSTA_EN 0x00000001 #define PAS_DMA_RXINT_RCMDSTA_ST 0x00000002 #define PAS_DMA_RXINT_RCMDSTA_MBT 0x00000008 #define PAS_DMA_RXINT_RCMDSTA_MDR 0x00000010 #define PAS_DMA_RXINT_RCMDSTA_MOO 0x00000020 #define PAS_DMA_RXINT_RCMDSTA_MBP 0x00000040 #define PAS_DMA_RXINT_RCMDSTA_BT 0x00000800 #define PAS_DMA_RXINT_RCMDSTA_DR 0x00001000 #define PAS_DMA_RXINT_RCMDSTA_OO 0x00002000 #define PAS_DMA_RXINT_RCMDSTA_BP 0x00004000 #define PAS_DMA_RXINT_RCMDSTA_TB 0x00008000 #define PAS_DMA_RXINT_RCMDSTA_ACT 0x00010000 #define PAS_DMA_RXINT_RCMDSTA_DROPS_M 0xfffe0000 #define PAS_DMA_RXINT_RCMDSTA_DROPS_S 17 #define PAS_DMA_RXINT_CFG(i) (0x204+(i)*_PAS_DMA_RXINT_STRIDE) #define PAS_DMA_RXINT_CFG_RBP 0x80000000 #define PAS_DMA_RXINT_CFG_ITRR 0x40000000 #define PAS_DMA_RXINT_CFG_DHL_M 0x07000000 #define PAS_DMA_RXINT_CFG_DHL_S 24 #define PAS_DMA_RXINT_CFG_DHL(x) (((x) << PAS_DMA_RXINT_CFG_DHL_S) & \ PAS_DMA_RXINT_CFG_DHL_M) #define PAS_DMA_RXINT_CFG_ITR 0x00400000 #define PAS_DMA_RXINT_CFG_LW 0x00200000 #define PAS_DMA_RXINT_CFG_L2 0x00100000 #define PAS_DMA_RXINT_CFG_HEN 0x00080000 #define PAS_DMA_RXINT_CFG_WIF 0x00000002 #define PAS_DMA_RXINT_CFG_WIL 0x00000001 #define PAS_DMA_RXINT_INCR(i) (0x210+(i)*_PAS_DMA_RXINT_STRIDE) #define PAS_DMA_RXINT_INCR_INCR_M 0x0000ffff #define PAS_DMA_RXINT_INCR_INCR_S 0 #define PAS_DMA_RXINT_INCR_INCR(x) ((x) & 0x0000ffff) #define PAS_DMA_RXINT_BASEL(i) (0x218+(i)*_PAS_DMA_RXINT_STRIDE) #define PAS_DMA_RXINT_BASEL_BRBL(x) ((x) & ~0x3f) #define PAS_DMA_RXINT_BASEU(i) (0x21c+(i)*_PAS_DMA_RXINT_STRIDE) #define PAS_DMA_RXINT_BASEU_BRBH(x) ((x) & 0xfff) #define PAS_DMA_RXINT_BASEU_SIZ_M 0x3fff0000 /* # of cache lines worth of buffer ring */ #define PAS_DMA_RXINT_BASEU_SIZ_S 16 /* 0 = 16K */ #define PAS_DMA_RXINT_BASEU_SIZ(x) (((x) << PAS_DMA_RXINT_BASEU_SIZ_S) & \ PAS_DMA_RXINT_BASEU_SIZ_M) #define _PAS_DMA_TXCHAN_STRIDE 0x20 /* Size per channel */ #define _PAS_DMA_TXCHAN_TCMDSTA 0x300 /* Command / Status */ #define _PAS_DMA_TXCHAN_CFG 0x304 /* Configuration */ #define _PAS_DMA_TXCHAN_DSCRBU 0x308 /* Descriptor BU Allocation */ #define _PAS_DMA_TXCHAN_INCR 0x310 /* Descriptor increment */ #define _PAS_DMA_TXCHAN_CNT 0x314 /* Descriptor count/offset */ #define _PAS_DMA_TXCHAN_BASEL 0x318 /* Descriptor ring base (low) */ #define _PAS_DMA_TXCHAN_BASEU 0x31c /* (high) */ #define PAS_DMA_TXCHAN_TCMDSTA(c) (0x300+(c)*_PAS_DMA_TXCHAN_STRIDE) #define PAS_DMA_TXCHAN_TCMDSTA_EN 0x00000001 /* Enabled */ #define PAS_DMA_TXCHAN_TCMDSTA_ST 0x00000002 /* Stop interface */ #define PAS_DMA_TXCHAN_TCMDSTA_ACT 0x00010000 /* Active */ #define PAS_DMA_TXCHAN_TCMDSTA_SZ 0x00000800 #define PAS_DMA_TXCHAN_TCMDSTA_DB 0x00000400 #define PAS_DMA_TXCHAN_TCMDSTA_DE 0x00000200 #define PAS_DMA_TXCHAN_TCMDSTA_DA 0x00000100 #define PAS_DMA_TXCHAN_CFG(c) (0x304+(c)*_PAS_DMA_TXCHAN_STRIDE) #define PAS_DMA_TXCHAN_CFG_TY_IFACE 0x00000000 /* Type = interface */ #define PAS_DMA_TXCHAN_CFG_TY_COPY 0x00000001 /* Type = copy only */ #define PAS_DMA_TXCHAN_CFG_TY_FUNC 0x00000002 /* Type = function */ #define PAS_DMA_TXCHAN_CFG_TY_XOR 0x00000003 /* Type = xor only */ #define PAS_DMA_TXCHAN_CFG_TATTR_M 0x0000003c #define PAS_DMA_TXCHAN_CFG_TATTR_S 2 #define PAS_DMA_TXCHAN_CFG_TATTR(x) (((x) << PAS_DMA_TXCHAN_CFG_TATTR_S) & \ PAS_DMA_TXCHAN_CFG_TATTR_M) #define PAS_DMA_TXCHAN_CFG_LPDQ 0x00000800 #define PAS_DMA_TXCHAN_CFG_LPSQ 0x00000400 #define PAS_DMA_TXCHAN_CFG_WT_M 0x000003c0 #define PAS_DMA_TXCHAN_CFG_WT_S 6 #define PAS_DMA_TXCHAN_CFG_WT(x) (((x) << PAS_DMA_TXCHAN_CFG_WT_S) & \ PAS_DMA_TXCHAN_CFG_WT_M) #define PAS_DMA_TXCHAN_CFG_TRD 0x00010000 /* translate data */ #define PAS_DMA_TXCHAN_CFG_TRR 0x00008000 /* translate rings */ #define PAS_DMA_TXCHAN_CFG_UP 0x00004000 /* update tx descr when sent */ #define PAS_DMA_TXCHAN_CFG_CL 0x00002000 /* Clean last line */ #define PAS_DMA_TXCHAN_CFG_CF 0x00001000 /* Clean first line */ #define PAS_DMA_TXCHAN_INCR(c) (0x310+(c)*_PAS_DMA_TXCHAN_STRIDE) #define PAS_DMA_TXCHAN_BASEL(c) (0x318+(c)*_PAS_DMA_TXCHAN_STRIDE) #define PAS_DMA_TXCHAN_BASEL_BRBL_M 0xffffffc0 #define PAS_DMA_TXCHAN_BASEL_BRBL_S 0 #define PAS_DMA_TXCHAN_BASEL_BRBL(x) (((x) << PAS_DMA_TXCHAN_BASEL_BRBL_S) & \ PAS_DMA_TXCHAN_BASEL_BRBL_M) #define PAS_DMA_TXCHAN_BASEU(c) (0x31c+(c)*_PAS_DMA_TXCHAN_STRIDE) #define PAS_DMA_TXCHAN_BASEU_BRBH_M 0x00000fff #define PAS_DMA_TXCHAN_BASEU_BRBH_S 0 #define PAS_DMA_TXCHAN_BASEU_BRBH(x) (((x) << PAS_DMA_TXCHAN_BASEU_BRBH_S) & \ PAS_DMA_TXCHAN_BASEU_BRBH_M) /* # of cache lines worth of buffer ring */ #define PAS_DMA_TXCHAN_BASEU_SIZ_M 0x3fff0000 #define PAS_DMA_TXCHAN_BASEU_SIZ_S 16 /* 0 = 16K */ #define PAS_DMA_TXCHAN_BASEU_SIZ(x) (((x) << PAS_DMA_TXCHAN_BASEU_SIZ_S) & \ PAS_DMA_TXCHAN_BASEU_SIZ_M) #define _PAS_DMA_RXCHAN_STRIDE 0x20 /* Size per channel */ #define _PAS_DMA_RXCHAN_CCMDSTA 0x800 /* Command / Status */ #define _PAS_DMA_RXCHAN_CFG 0x804 /* Configuration */ #define _PAS_DMA_RXCHAN_INCR 0x810 /* Descriptor increment */ #define _PAS_DMA_RXCHAN_CNT 0x814 /* Descriptor count/offset */ #define _PAS_DMA_RXCHAN_BASEL 0x818 /* Descriptor ring base (low) */ #define _PAS_DMA_RXCHAN_BASEU 0x81c /* (high) */ #define PAS_DMA_RXCHAN_CCMDSTA(c) (0x800+(c)*_PAS_DMA_RXCHAN_STRIDE) #define PAS_DMA_RXCHAN_CCMDSTA_EN 0x00000001 /* Enabled */ #define PAS_DMA_RXCHAN_CCMDSTA_ST 0x00000002 /* Stop interface */ #define PAS_DMA_RXCHAN_CCMDSTA_ACT 0x00010000 /* Active */ #define PAS_DMA_RXCHAN_CCMDSTA_DU 0x00020000 #define PAS_DMA_RXCHAN_CCMDSTA_OD 0x00002000 #define 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#define PAS_DMA_RXCHAN_BASEU_SIZ_M 0x3fff0000 #define PAS_DMA_RXCHAN_BASEU_SIZ_S 16 /* 0 = 16K */ #define PAS_DMA_RXCHAN_BASEU_SIZ(x) (((x) << PAS_DMA_RXCHAN_BASEU_SIZ_S) & \ PAS_DMA_RXCHAN_BASEU_SIZ_M) #define PAS_STATUS_PCNT_M 0x000000000000ffffull #define PAS_STATUS_PCNT_S 0 #define PAS_STATUS_DCNT_M 0x00000000ffff0000ull #define PAS_STATUS_DCNT_S 16 #define PAS_STATUS_BPCNT_M 0x0000ffff00000000ull #define PAS_STATUS_BPCNT_S 32 #define PAS_STATUS_CAUSE_M 0xf000000000000000ull #define PAS_STATUS_TIMER 0x1000000000000000ull #define PAS_STATUS_ERROR 0x2000000000000000ull #define PAS_STATUS_SOFT 0x4000000000000000ull #define PAS_STATUS_INT 0x8000000000000000ull #define PAS_IOB_COM_PKTHDRCNT 0x120 #define PAS_IOB_COM_PKTHDRCNT_PKTHDR1_M 0x0fff0000 #define PAS_IOB_COM_PKTHDRCNT_PKTHDR1_S 16 #define PAS_IOB_COM_PKTHDRCNT_PKTHDR0_M 0x00000fff #define PAS_IOB_COM_PKTHDRCNT_PKTHDR0_S 0 #define PAS_IOB_DMA_RXCH_CFG(i) (0x1100 + (i)*4) #define PAS_IOB_DMA_RXCH_CFG_CNTTH_M 0x00000fff #define PAS_IOB_DMA_RXCH_CFG_CNTTH_S 0 #define PAS_IOB_DMA_RXCH_CFG_CNTTH(x) (((x) << PAS_IOB_DMA_RXCH_CFG_CNTTH_S) & \ PAS_IOB_DMA_RXCH_CFG_CNTTH_M) #define PAS_IOB_DMA_TXCH_CFG(i) (0x1200 + (i)*4) #define PAS_IOB_DMA_TXCH_CFG_CNTTH_M 0x00000fff #define PAS_IOB_DMA_TXCH_CFG_CNTTH_S 0 #define PAS_IOB_DMA_TXCH_CFG_CNTTH(x) (((x) << PAS_IOB_DMA_TXCH_CFG_CNTTH_S) & \ PAS_IOB_DMA_TXCH_CFG_CNTTH_M) #define PAS_IOB_DMA_RXCH_STAT(i) (0x1300 + (i)*4) #define PAS_IOB_DMA_RXCH_STAT_INTGEN 0x00001000 #define PAS_IOB_DMA_RXCH_STAT_CNTDEL_M 0x00000fff #define PAS_IOB_DMA_RXCH_STAT_CNTDEL_S 0 #define PAS_IOB_DMA_RXCH_STAT_CNTDEL(x) (((x) << PAS_IOB_DMA_RXCH_STAT_CNTDEL_S) &\ PAS_IOB_DMA_RXCH_STAT_CNTDEL_M) #define PAS_IOB_DMA_TXCH_STAT(i) (0x1400 + (i)*4) #define PAS_IOB_DMA_TXCH_STAT_INTGEN 0x00001000 #define PAS_IOB_DMA_TXCH_STAT_CNTDEL_M 0x00000fff #define PAS_IOB_DMA_TXCH_STAT_CNTDEL_S 0 #define PAS_IOB_DMA_TXCH_STAT_CNTDEL(x) (((x) << PAS_IOB_DMA_TXCH_STAT_CNTDEL_S) &\ PAS_IOB_DMA_TXCH_STAT_CNTDEL_M) #define PAS_IOB_DMA_RXCH_RESET(i) (0x1500 + (i)*4) #define PAS_IOB_DMA_RXCH_RESET_PCNT_M 0xffff0000 #define PAS_IOB_DMA_RXCH_RESET_PCNT_S 16 #define PAS_IOB_DMA_RXCH_RESET_PCNT(x) (((x) << PAS_IOB_DMA_RXCH_RESET_PCNT_S) & \ PAS_IOB_DMA_RXCH_RESET_PCNT_M) #define PAS_IOB_DMA_RXCH_RESET_PCNTRST 0x00000020 #define PAS_IOB_DMA_RXCH_RESET_DCNTRST 0x00000010 #define PAS_IOB_DMA_RXCH_RESET_TINTC 0x00000008 #define PAS_IOB_DMA_RXCH_RESET_DINTC 0x00000004 #define PAS_IOB_DMA_RXCH_RESET_SINTC 0x00000002 #define PAS_IOB_DMA_RXCH_RESET_PINTC 0x00000001 #define PAS_IOB_DMA_TXCH_RESET(i) (0x1600 + (i)*4) #define PAS_IOB_DMA_TXCH_RESET_PCNT_M 0xffff0000 #define PAS_IOB_DMA_TXCH_RESET_PCNT_S 16 #define PAS_IOB_DMA_TXCH_RESET_PCNT(x) (((x) << PAS_IOB_DMA_TXCH_RESET_PCNT_S) & \ PAS_IOB_DMA_TXCH_RESET_PCNT_M) #define PAS_IOB_DMA_TXCH_RESET_PCNTRST 0x00000020 #define PAS_IOB_DMA_TXCH_RESET_DCNTRST 0x00000010 #define PAS_IOB_DMA_TXCH_RESET_TINTC 0x00000008 #define PAS_IOB_DMA_TXCH_RESET_DINTC 0x00000004 #define PAS_IOB_DMA_TXCH_RESET_SINTC 0x00000002 #define PAS_IOB_DMA_TXCH_RESET_PINTC 0x00000001 #define PAS_IOB_DMA_COM_TIMEOUTCFG 0x1700 #define PAS_IOB_DMA_COM_TIMEOUTCFG_TCNT_M 0x00ffffff #define PAS_IOB_DMA_COM_TIMEOUTCFG_TCNT_S 0 #define PAS_IOB_DMA_COM_TIMEOUTCFG_TCNT(x) (((x) << PAS_IOB_DMA_COM_TIMEOUTCFG_TCNT_S) & \ PAS_IOB_DMA_COM_TIMEOUTCFG_TCNT_M) /* Transmit descriptor fields */ #define XCT_MACTX_T 0x8000000000000000ull #define XCT_MACTX_ST 0x4000000000000000ull #define XCT_MACTX_NORES 0x0000000000000000ull #define XCT_MACTX_8BRES 0x1000000000000000ull #define XCT_MACTX_24BRES 0x2000000000000000ull #define XCT_MACTX_40BRES 0x3000000000000000ull #define XCT_MACTX_I 0x0800000000000000ull #define XCT_MACTX_O 0x0400000000000000ull #define XCT_MACTX_E 0x0200000000000000ull #define XCT_MACTX_VLAN_M 0x0180000000000000ull #define XCT_MACTX_VLAN_NOP 0x0000000000000000ull #define XCT_MACTX_VLAN_REMOVE 0x0080000000000000ull #define XCT_MACTX_VLAN_INSERT 0x0100000000000000ull #define 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Right now only limitations used are event types 0/1, * for event-triggered DMA transactions. */ enum pasemi_dmachan_type { RXCHAN = 0, /* Any RX chan */ TXCHAN = 1, /* Any TX chan */ TXCHAN_EVT0 = 0x1001, /* TX chan in event class 0 (chan 0-9) */ TXCHAN_EVT1 = 0x2001, /* TX chan in event class 1 (chan 10-19) */ }; struct pasemi_dmachan { int chno; /* Channel number */ enum pasemi_dmachan_type chan_type; /* TX / RX */ u64 *status; /* Ptr to cacheable status */ int irq; /* IRQ used by channel */ unsigned int ring_size; /* size of allocated ring */ dma_addr_t ring_dma; /* DMA address for ring */ u64 *ring_virt; /* Virt address for ring */ void *priv; /* Ptr to start of client struct */ }; /* Read/write the different registers in the I/O Bridge, Ethernet * and DMA Controller */ extern unsigned int pasemi_read_iob_reg(unsigned int reg); extern void pasemi_write_iob_reg(unsigned int reg, unsigned int val); extern unsigned int pasemi_read_mac_reg(int intf, unsigned int reg); extern void pasemi_write_mac_reg(int intf, unsigned int reg, unsigned int val); extern unsigned int pasemi_read_dma_reg(unsigned int reg); extern void pasemi_write_dma_reg(unsigned int reg, unsigned int val); /* Channel management routines */ extern void *pasemi_dma_alloc_chan(enum pasemi_dmachan_type type, int total_size, int offset); extern void pasemi_dma_free_chan(struct pasemi_dmachan *chan); extern void pasemi_dma_start_chan(const struct pasemi_dmachan *chan, const u32 cmdsta); extern int pasemi_dma_stop_chan(const struct pasemi_dmachan *chan); /* Common routines to allocate rings and buffers */ extern int pasemi_dma_alloc_ring(struct pasemi_dmachan *chan, int ring_size); extern void pasemi_dma_free_ring(struct pasemi_dmachan *chan); extern void *pasemi_dma_alloc_buf(struct pasemi_dmachan *chan, int size, dma_addr_t *handle); extern void pasemi_dma_free_buf(struct pasemi_dmachan *chan, int size, dma_addr_t *handle); /* Routines to allocate flags (events) for channel synchronization */ extern int pasemi_dma_alloc_flag(void); extern void pasemi_dma_free_flag(int flag); extern void pasemi_dma_set_flag(int flag); extern void pasemi_dma_clear_flag(int flag); /* Routines to allocate function engines */ extern int pasemi_dma_alloc_fun(void); extern void pasemi_dma_free_fun(int fun); /* Initialize the library, must be called before any other functions */ extern int pasemi_dma_init(void); #endif /* ASM_PASEMI_DMA_H */

Es la eliminación del sarro y la placa adherida a la superficie de los dientes mediante un equipo de ultrasonidos que garantiza la integridad de las piezas dentales a la vez que elimina en profundidad cualquier resto de suciedad.

A continuación se procede al pulido de los dientes mediante una fresa especial que elimina la placa bacteriana y devuelve a los dientes el aspecto sano que deben tener.

Una vez terminado todo el proceso, se mantiene al perro en observación hasta que se despierta de la anestesia, bajo la atenta supervisión de un veterinario.

¿Cada cuánto tiempo tengo que hacerle una limpieza dental a mi perro?

A partir de cierta edad, los perros pueden necesitar una limpieza dental anual o bianual. Depende de cada caso. En líneas generales, puede decirse que los perros de razas pequeñas suelen acumular más sarro y suelen necesitar una atención mayor en cuanto a higiene dental.

Riesgos de una mala higiene

Los riesgos más evidentes de una mala higiene dental en los perros son los siguientes:

Cuando la acumulación de sarro no se trata, se puede producir una inflamación y retracción de las encías que puede descalzar el diente y provocar caídas.
Mal aliento (halitosis).
Sarro perros
Puede ir a más
Las bacterias de la placa pueden trasladarse a través del torrente circulatorio a órganos vitales como el corazón ocasionando problemas de endocarditis en las válvulas. Las bacterias pueden incluso acantonarse en huesos (La osteomielitis es la infección ósea, tanto cortical como medular) provocando mucho dolor y una artritis séptica).

¿Cómo se forma el sarro?

El sarro es la calcificación de la placa dental. Los restos de alimentos, junto con las bacterias presentes en la boca, van a formar la placa bacteriana o placa dental. Si la placa no se retira, al mezclarse con la saliva y los minerales presentes en ella, reaccionará formando una costra. La placa se calcifica y se forma el sarro.

El sarro, cuando se forma, es de color blanquecino pero a medida que pasa el tiempo se va poniendo amarillo y luego marrón.

Síntomas de una pobre higiene dental
La señal más obvia de una mala salud dental canina es el mal aliento.

Sin embargo, a veces no es tan fácil de detectar
Y hay perros que no se dejan abrir la boca por su dueño. Por ejemplo…

Recientemente nos trajeron a la clínica a un perro que parpadeaba de un ojo y decía su dueño que le picaba un lado de la cara. Tenía molestias y dificultad para comer, lo que había llevado a sus dueños a comprarle comida blanda (que suele ser un poco más cara y llevar más contenido en grasa) durante medio año. Después de una exploración oftalmológica, nos dimos cuenta de que el ojo tenía una úlcera en la córnea probablemente de rascarse . Además, el canto lateral del ojo estaba inflamado. Tenía lo que en humanos llamamos flemón pero como era un perro de pelo largo, no se le notaba a simple vista. Al abrirle la boca nos llamó la atención el ver una muela llena de sarro. Le realizamos una radiografía y encontramos una fístula que llegaba hasta la parte inferior del ojo.

Le tuvimos que extraer la muela. Tras esto, el ojo se curó completamente con unos colirios y una lentilla protectora de úlcera. Afortunadamente, la úlcera no profundizó y no perforó el ojo. Ahora el perro come perfectamente a pesar de haber perdido una muela.

¿Cómo mantener la higiene dental de tu perro?
Hay varias maneras de prevenir problemas derivados de la salud dental de tu perro.

Limpiezas de dientes en casa
Es recomendable limpiar los dientes de tu perro semanal o diariamente si se puede. Existe una gran variedad de productos que se pueden utilizar:

Pastas de dientes.
Cepillos de dientes o dedales para el dedo índice, que hacen más fácil la limpieza.
Colutorios para echar en agua de bebida o directamente sobre el diente en líquido o en spray.

En la Clínica Tus Veterinarios enseñamos a nuestros clientes a tomar el hábito de limpiar los dientes de sus perros desde que son cachorros. Esto responde a nuestro compromiso con la prevención de enfermedades caninas.

Hoy en día tenemos muchos clientes que limpian los dientes todos los días a su mascota, y como resultado, se ahorran el dinero de hacer limpiezas dentales profesionales y consiguen una mejor salud de su perro.

Limpiezas dentales profesionales de perros y gatos

Recomendamos hacer una limpieza dental especializada anualmente. La realizamos con un aparato de ultrasonidos que utiliza agua para quitar el sarro. Después, procedemos a pulir los dientes con un cepillo de alta velocidad y una pasta especial. Hacemos esto para proteger el esmalte.

La frecuencia de limpiezas dentales necesaria varía mucho entre razas. En general, las razas grandes tienen buena calidad de esmalte, por lo que no necesitan hacerlo tan a menudo e incluso pueden pasarse la vida sin requerir una limpieza. Sin embargo, razas pequeñas como el Yorkshire o el Maltés, deben hacérselas todos los años desde cachorros si se quiere conservar sus piezas dentales.

Otro factor fundamental es la calidad del pienso. Algunas marcas han diseñado croquetas que limpian la superficie del diente y de la muela al masticarse.

Ultrasonido para perros

¿Se necesita anestesia para las limpiezas dentales de perros y gatos?

La limpieza dental en perros no es una técnica que pueda practicarse sin anestesia general , aunque hay veces que los propietarios no quieren anestesiar y si tiene poco sarro y el perro es muy bueno se puede intentar…… , pero no se va a poder pulir ni acceder a todas la zona de la boca …. Además los limpiadores dentales van a irrigar agua y hay riesgo de aspiración a vías respiratorias si no se realiza una anestesia correcta con intubación traqueal . En resumen , sin anestesia no se va hacer una correcta limpieza dental.

Tampoco sirve la sedación ya que necesitamos que el animal esté totalmente quieto, y el veterinario tenga un acceso completo a todas sus piezas dentales y encías.

Alimentos para la limpieza dental

Hay que tener cierto cuidado a la hora de comprar determinados alimentos porque no todos son saludables. Algunos tienen demasiado contenido graso, que en exceso puede causar problemas cardiovasculares y obesidad.

Los mejores alimentos para los dientes son aquellos que están elaborados por empresas farmacéuticas y llevan componentes químicos con tratamientos específicos para el diente del perro. Esto implica no solo limpieza a través de la acción mecánica de morder sino también un tratamiento antibacteriano para prevenir el sarro.

Conclusión

Si eres como la mayoría de dueños, por falta de tiempo , es probable que no estés prestando la suficiente atención a la limpieza dental de tu perro. Por eso te animamos a que comiences a limpiar los dientes de tu perro y consideres atender a su higiene bucal con frecuencia.

Estas simples medidas pueden conllevar a que tu perro tenga una vida más larga y mucho más saludable.

Si te resulta imposible introducir un cepillo de dientes a tu perro en la boca, pásate con él por clínica Tus Veterinarios y te explicamos cómo hacerlo.

Necesitas hacer una limpieza dental profesional a tu mascota?
Llámanos al 622575274 o contacta con nosotros

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Riesgos de una mala higiene

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